怎样降低通讯PCB设计风险?
工程师在PCB设计过程中,假如能提前预知可能的风险,进行规避,PCB设计成功率会大幅度提高。
现在我们来谈谈降低PCB设计风险的三点技巧。
1.系统规划阶段就考虑信号完整性问题,整个系统这样搭建,信号从一块PCB传到另一块PCB能不能正确接收?这在前期就要评估,而评估这个问题其实并不是很难,懂一点信号完整性知识,会一点简单的软件操作就能做到。
2.在PCB设计过程中,使用软件评估具体走线,观察信号质量能不能满足要求,这个过程本身非常简单,关键是要理解信号完整性的原理知识,并用来指导。
3.做PCB的过程中,一定要进行风险控制。有不少问题,目前软件还没有办法解决,必须设计者人为控制。这一步关键是了解哪些地方会有风险,怎样做才能规避风险,需要的还是信号完整性知识。
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PCB板变形的危害
在自动化表面贴装线上,电路板若不平整,会引起定位不准,元器件无法插装或贴装到板子的孔和表面贴装焊盘上,甚至会撞坏自动插装机。装上元器件的电路板焊接后发生弯曲,元件脚很难剪平整齐。板子也无法装到机箱或机内的插座上,装配厂碰到板翘同样是十分烦恼。目前的表面贴装技术正在朝着高精度、高速度、智能化方向发展,这就对做为各种元器件提出了更高的平整度要求。
PCB板由铜箔、树脂、玻璃布等材料组成,各材料物理和化学性能均不相同,压合在一起后必然会产生热应力残留,导致变形。在PCB的加工过程中,会经过高温、机械切削、湿处理等各种流程,也会对板件变形产生重要影响,总之可以导致PCB板变形的原因复杂多样,如何减少或消除由于材料特性不同或者加工引起的变形,成为PCB制造商面临的Zui复杂问题之一。
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添加测试点会不会影响高速信号的质量?
会不会影响信号质量就要看加测试点的方式和信号到底多快而定。基本上外加的测试点(不用在线既有的穿孔(viaor DIPpin)当测试点)可能加在在线或是从在线拉一小段线出来。前者相当于是加上一个很小的电容在线,后者则是多了一段分支。这两个情况都会对高速信号多多少少会有点影响,影响的程度就跟信号的频率速度和信号缘变化率(edgerate)有关。影响大小可透过仿真得知。原则上测试点越小越好(当然还要满足测试机具的要求)分支越短越好。
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